HDLBits刷题_Verilog Language_Bcdadd100_bcd add100_Little_Engineer456的博客-程序员宅基地

You are provided with a BCD one-digit adder named bcd_fadd that adds two BCD digits and carry-in, and produces a sum and carry-out.

module bcd_fadd {
    input [3:0] a,
    input [3:0] b,
    input     cin,
    output   cout,
    output [3:0] sum );

Instantiate 100 copies of bcd_fadd to create a 100-digit BCD ripple-carry adder. Your adder should add two 100-digit BCD numbers (packed into 400-bit vectors) and a carry-in to produce a 100-digit sum and carry out.

注意：这一题中，貌似always内不能调用块，因此造成很大的误导。另未用bac_fadd块也可完成。

module top_module( 
    input [399:0] a, b,
    input cin,
    output cout,
    output [399:0] sum );
    
    //assign cout = (sum[3:0] > 9) ? 1 : 0 ;
    /*wire [4:0] me;
    wire [3:0] ml;
    always @(*)begin
        me = a[3:0] + b[3:0] + cin;
        sum[3:0] = (me < 10) ? me: (me-10);
        cout = (me > 9) ? 1 : 0 ;
        for (int i=4; i<400; i=i+4)
        begin
            me = a[i+:4] + b[i+:4] + cout;
            sum[i+:4] = (me < 10) ? me: (me-10);
            cout = (me > 9) ? 1 : 0 ;
        end
    end*/
    wire [400:0] cout1;
    bcd_fadd add0(a[3:0],b[3:0],cin,cout1[4],sum[3:0]);
    always @(*)begin 
        for (i=4; i<400; i=i+4) begin
            bcd_fadd add1(a[i+:4], b[i+:4], cout1[i], cout1[i+4], sum[i+:4]); //使用 
                                                                //always不能调用module块
        end
    end
    assign cout = cunt1[i];
    
    /*wire [99:0] temp;
    bcd_fadd add0(a[3:0],b[3:0],cin,temp[0],sum[3:0]);
    genvar i;
    generate 
        for(i=4;i<400;i=i+4) begin: add45
            bcd_fadd add1(a[i+3:i],b[i+3:i],temp[(i>>2)-1],temp[i>>2],sum[i+3:i]);
        end
    endgenerate
    assign cout = temp[99];*/

endmodule

本文链接：https://blog.csdn.net/m0_65438107/article/details/122115879

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